利用Quartus的Partition功能減少FPGA編譯時(shí)間

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此文章選自本人2015年5月郵件內(nèi)容

一個(gè)簡(jiǎn)單的可有效減少Q(mào)uartus編譯時(shí)間的方法。
此方法可以:
1)大幅度減少編譯時(shí)間(我的程序從42分鐘減少到25分鐘,減少40%)
2)可以鎖死不需要改動(dòng)的模塊,保證時(shí)序性能不變

但是前提是:每次編譯時(shí)大部分模塊是不變動(dòng)的,只是修改部分模塊(這樣不變動(dòng)的模塊保留上次編譯結(jié)果,才能節(jié)省時(shí)間)

具體方法:
1)先全編譯一遍程序,確認(rèn)編譯結(jié)果正確
2)打開(kāi)Quartus的Design Partitions Window (Menu-->Assignments)
3)劃分程序各個(gè)模塊為若干Partition,例如調(diào)制、上變頻、下變頻、時(shí)鐘載波、均衡、譯碼6個(gè)Partitions
4)將6個(gè)Partitions的Netlist Type設(shè)置為Post-fit。這樣,再次編譯時(shí),這6個(gè)模塊都會(huì)保持上一次的布局布線,并減少編譯時(shí)間
5)如果再次編譯前修改了某個(gè)模塊,比如調(diào)制模塊,那么把調(diào)制模塊的Netlist Type 設(shè)置改為Source File,那么該模塊編譯時(shí)重新布局布線

備注:

  • Partitions的劃分和接口設(shè)計(jì)也是有講究的,這個(gè)以后有機(jī)會(huì)再分享
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